From mboxrd@z Thu Jan  1 00:00:00 1970
Return-Path: <juzhe.zhong@rivai.ai>
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 for <gcc-patches@gcc.gnu.org>; Wed,  1 Jun 2022 02:30:56 +0000 (GMT)
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Authentication-Results: sourceware.org;
 dmarc=none (p=none dis=none) header.from=rivai.ai
Authentication-Results: sourceware.org; spf=pass smtp.mailfrom=rivai.ai
X-QQ-mid: bizesmtp68t1654050651t7onwhf4
Received: from server1.localdomain ( [42.247.22.65])
 by bizesmtp.qq.com (ESMTP) with 
 id ; Wed, 01 Jun 2022 10:30:51 +0800 (CST)
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 d1oH1PiuE+61C8Hd30ybIVvQM5MuD8aCxJb5AUW2iJjaDxlJ2OuMSMN/biRZhA9KasyE7ng
 RIgfS+5PVgo9aaEHLY=
X-QQ-GoodBg: 2
From: juzhe.zhong@rivai.ai
To: gcc-patches@gcc.gnu.org
Cc: zhongjuzhe <juzhe.zhong@rivai.ai>
Subject: [PATCH v4 31/34]   RISC-V: Add vsex.C
Date: Wed,  1 Jun 2022 10:29:14 +0800
Message-Id: <20220601022917.270325-32-juzhe.zhong@rivai.ai>
X-Mailer: git-send-email 2.36.1
In-Reply-To: <20220601022917.270325-1-juzhe.zhong@rivai.ai>
References: <20220601022917.270325-1-juzhe.zhong@rivai.ai>
MIME-Version: 1.0
Content-Transfer-Encoding: quoted-printable
X-QQ-SENDSIZE: 520
Feedback-ID: bizesmtp:rivai.ai:qybgforeign:qybgforeign8
X-QQ-Bgrelay: 1
X-Spam-Status: No, score=-2.9 required=5.0 tests=BAYES_00, GIT_PATCH_0,
 KAM_DMARC_STATUS, RCVD_IN_DNSWL_NONE, RCVD_IN_MSPIKE_H2, SPF_HELO_PASS,
 SPF_PASS, TXREP, T_SCC_BODY_TEXT_LINE,
 UNWANTED_LANGUAGE_BODY autolearn=ham autolearn_force=no version=3.4.6
X-Spam-Checker-Version: SpamAssassin 3.4.6 (2021-04-09) on
 server2.sourceware.org
X-BeenThere: gcc-patches@gcc.gnu.org
X-Mailman-Version: 2.1.29
Precedence: list
List-Id: Gcc-patches mailing list <gcc-patches.gcc.gnu.org>
List-Unsubscribe: <https://gcc.gnu.org/mailman/options/gcc-patches>,
 <mailto:gcc-patches-request@gcc.gnu.org?subject=unsubscribe>
List-Archive: <https://gcc.gnu.org/pipermail/gcc-patches/>
List-Post: <mailto:gcc-patches@gcc.gnu.org>
List-Help: <mailto:gcc-patches-request@gcc.gnu.org?subject=help>
List-Subscribe: <https://gcc.gnu.org/mailman/listinfo/gcc-patches>,
 <mailto:gcc-patches-request@gcc.gnu.org?subject=subscribe>
X-List-Received-Date: Wed, 01 Jun 2022 02:31:03 -0000

From: zhongjuzhe <juzhe.zhong@rivai.ai>=0D

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=0D
        * g++.target/riscv/rvv/vsex.C: New test.=0D
=0D
---=0D
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 1 file changed, 1704 insertions(+)=0D
 create mode 100644 gcc/testsuite/g++.target/riscv/rvv/vsex.C=0D
=0D
diff --git a/gcc/testsuite/g++.target/riscv/rvv/vsex.C b/gcc/testsuite/g++.=
target/riscv/rvv/vsex.C=0D
new file mode 100644=0D
index 00000000000..88aac87922f=0D
--- /dev/null=0D
+++ b/gcc/testsuite/g++.target/riscv/rvv/vsex.C=0D
@@ -0,0 +1,1704 @@=0D
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*" } } */=0D
+/* { dg-final { check-function-bodies "**" "" } } */=0D
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+#include <riscv_vector.h>=0D
+=0D
+=0D
+/*=0D
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+**  ...=0D
+**	vse32\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
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+  vse32 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32mf2_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*mf2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse32_v_f32mf2_m (vbool64_t mask, float32_t *base, vfloat32mf2_t v0, =
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+{=0D
+  vse32 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m1:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m1,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
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+{=0D
+  vse32 (base, v0, vl);=0D
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+=0D
+=0D
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+** test_vse32_v_f32m1_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m1,\s*t[au],\s*m[au]=0D
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+**	vse32\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
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ze_t vl)=0D
+{=0D
+  vse32 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m2:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
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+  vse32 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m2_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse32_v_f32m2_m (vbool16_t mask, float32_t *base, vfloat32m2_t v0, si=
ze_t vl)=0D
+{=0D
+  vse32 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m4:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
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+  vse32 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m4_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse32_v_f32m4_m (vbool8_t mask, float32_t *base, vfloat32m4_t v0, siz=
e_t vl)=0D
+{=0D
+  vse32 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m8:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse32_v_f32m8 (float32_t *base, vfloat32m8_t v0, size_t vl)=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse32_v_f32m8_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse32_v_f32m8_m (vbool4_t mask, float32_t *base, vfloat32m8_t v0, siz=
e_t vl)=0D
+{=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse64_v_f64m1:=0D
+**  ...=0D
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*m1,\s*t[au],\s*m[au]=0D
+**  ...=0D
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-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
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+  vse64 (base, v0, vl);=0D
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+=0D
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+** test_vse64_v_f64m1_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m1,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse64_v_f64m1_m (vbool64_t mask, float64_t *base, vfloat64m1_t v0, si=
ze_t vl)=0D
+{=0D
+  vse64 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse64_v_f64m2:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
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+**	vse64\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
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ze_t vl)=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse64_v_f64m4:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
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+=0D
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+** test_vse64_v_f64m4_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse64_v_f64m4_m (vbool16_t mask, float64_t *base, vfloat64m4_t v0, si=
ze_t vl)=0D
+{=0D
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+}=0D
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+=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\)=0D
+**  ...=0D
+**  ret=0D
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+=0D
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+**  ...=0D
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*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
+test_vse64_v_f64m8_m (vbool8_t mask, float64_t *base, vfloat64m8_t v0, siz=
e_t vl)=0D
+{=0D
+  vse64 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
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+** test_vse8_v_i8mf8:=0D
+**  ...=0D
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mf8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\)=0D
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+**  ret=0D
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+}=0D
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+=0D
+/*=0D
+** test_vse8_v_i8mf8_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
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+**  ...=0D
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+**  ret=0D
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+}=0D
+=0D
+=0D
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+**  ...=0D
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mf4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8mf4_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
mf4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
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+}=0D
+=0D
+=0D
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+**  ...=0D
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+**  ...=0D
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+**  ...=0D
+**  ret=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8mf2_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
mf2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+=0D
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+**  ...=0D
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+**  ret=0D
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+extern "C" void=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m1_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m1,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m1_m (vbool8_t mask, int8_t *base, vint8m1_t v0, size_t vl)=
=0D
+{=0D
+  vse8 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m2:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m2 (int8_t *base, vint8m2_t v0, size_t vl)=0D
+{=0D
+  vse8 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m2_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m2_m (vbool4_t mask, int8_t *base, vint8m2_t v0, size_t vl)=
=0D
+{=0D
+  vse8 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m4:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s1=
0|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m4 (int8_t *base, vint8m4_t v0, size_t vl)=0D
+{=0D
+  vse8 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m4_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s1=
0|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m4_m (vbool2_t mask, int8_t *base, vint8m4_t v0, size_t vl)=
=0D
+{=0D
+  vse8 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m8:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[=
0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m8 (int8_t *base, vint8m8_t v0, size_t vl)=0D
+{=0D
+  vse8 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse8_v_i8m8_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[=
0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse8_v_i8m8_m (vbool1_t mask, int8_t *base, vint8m8_t v0, size_t vl)=
=0D
+{=0D
+  vse8 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16mf4:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*mf4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse16_v_i16mf4 (int16_t *base, vint16mf4_t v0, size_t vl)=0D
+{=0D
+  vse16 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16mf4_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*mf4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse16_v_i16mf4_m (vbool64_t mask, int16_t *base, vint16mf4_t v0, size=
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16mf2:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*mf2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
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+{=0D
+  vse16 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
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+** test_vse16_v_i16mf2_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*mf2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+=0D
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+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*m1,\s*t[au],\s*m[au]=0D
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-9]|s10|s11|a[0-7])\)=0D
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+** test_vse16_v_i16m1_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
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+**  ...=0D
+**	vse16\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
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+extern "C" void=0D
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 vl)=0D
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+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16m2:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse16_v_i16m2 (int16_t *base, vint16m2_t v0, size_t vl)=0D
+{=0D
+  vse16 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16m2_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*m2,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse16_v_i16m2_m (vbool8_t mask, int16_t *base, vint16m2_t v0, size_t =
vl)=0D
+{=0D
+  vse16 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16m4:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse16_v_i16m4 (int16_t *base, vint16m4_t v0, size_t vl)=0D
+{=0D
+  vse16 (base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16m4_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
+test_vse16_v_i16m4_m (vbool4_t mask, int16_t *base, vint16m4_t v0, size_t =
vl)=0D
+{=0D
+  vse16 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse16_v_i16m8:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e16,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse16\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\)=0D
+**  ...=0D
+**  ret=0D
+*/=0D
+extern "C" void=0D
+test_vse16_v_i16m8 (int16_t *base, vint16m8_t v0, size_t vl)=0D
+{=0D
+  vse16 (base, v0, vl);=0D
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*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
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*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\),\s*v0\.t=0D
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+=0D
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+**  ...=0D
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-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
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-9]|s10|s11|a[0-7])\)=0D
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+=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m2,\s*t[au],\s*m[au]=0D
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+**	vse64\.v\s+(?:v[02468]|v[1-2][02468]|v30),\s*\((?:ra|[sgtf]p|t[0-6]|s[0=
-9]|s10|s11|a[0-7])\),\s*v0\.t=0D
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+**  ret=0D
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+{=0D
+  vse64 (mask, base, v0, vl);=0D
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+=0D
+/*=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m4,\s*t[au],\s*m[au]=0D
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+=0D
+=0D
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+** test_vse64_v_i64m8_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
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+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e8,\s*=
mf8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse8\.v\s+(?:v[0-9]|v[1-2][0-9]|v3[0-1]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-=
9]|s10|s11|a[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+**  ret=0D
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mf4,\s*t[au],\s*m[au]=0D
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+**  ...=0D
+**	vse8\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s1=
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+=0D
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+**  ret=0D
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+=0D
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+**  ...=0D
+**  ret=0D
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+=0D
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+**  ...=0D
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+**  ret=0D
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+=0D
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+**  ...=0D
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+**  ...=0D
+**  ret=0D
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+}=0D
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+=0D
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+**  ...=0D
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+**  ...=0D
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+=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e32,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse32\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+test_vse32_v_u32m8_m (vbool4_t mask, uint32_t *base, vuint32m8_t v0, size_=
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+**  ...=0D
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+=0D
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+** test_vse64_v_u64m2:=0D
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+**  ret=0D
+*/=0D
+extern "C" void=0D
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+  vse64 (mask, base, v0, vl);=0D
+}=0D
+=0D
+=0D
+/*=0D
+** test_vse64_v_u64m4:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\)=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m4,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[048]|v1[26]|v2[048]),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s=
10|s11|a[0-7])\),\s*v0\.t=0D
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+**  ret=0D
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+extern "C" void=0D
+test_vse64_v_u64m4_m (vbool16_t mask, uint64_t *base, vuint64m4_t v0, size=
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+=0D
+=0D
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+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\)=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
+test_vse64_v_u64m8 (uint64_t *base, vuint64m8_t v0, size_t vl)=0D
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+  vse64 (base, v0, vl);=0D
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+=0D
+=0D
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+** test_vse64_v_u64m8_m:=0D
+**  ...=0D
+**	vsetvli\s+zero,\s*(?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a[0-7]),\s*e64,\s=
*m8,\s*t[au],\s*m[au]=0D
+**  ...=0D
+**	vse64\.v\s+(?:v[08]|v16|v24),\s*\((?:ra|[sgtf]p|t[0-6]|s[0-9]|s10|s11|a=
[0-7])\),\s*v0\.t=0D
+**  ...=0D
+**  ret=0D
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+extern "C" void=0D
+test_vse64_v_u64m8_m (vbool8_t mask, uint64_t *base, vuint64m8_t v0, size_=
t vl)=0D
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+}=0D
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-- =0D
2.36.1=0D
=0D