From mboxrd@z Thu Jan 1 00:00:00 1970 Return-Path: Received: from smtpbguseast1.qq.com (smtpbguseast1.qq.com [54.204.34.129]) by sourceware.org (Postfix) with ESMTPS id 5E6423858C50 for ; Wed, 8 Feb 2023 20:57:33 +0000 (GMT) DMARC-Filter: OpenDMARC Filter v1.4.2 sourceware.org 5E6423858C50 Authentication-Results: sourceware.org; dmarc=none (p=none dis=none) header.from=rivai.ai Authentication-Results: sourceware.org; spf=pass smtp.mailfrom=rivai.ai X-QQ-mid: bizesmtp76t1675889848tsveg4ed Received: from rios-cad5.localdomain ( [58.60.1.11]) by bizesmtp.qq.com (ESMTP) with id ; Thu, 09 Feb 2023 04:57:27 +0800 (CST) X-QQ-SSF: 01400000000000E0L000000A0000000 X-QQ-FEAT: bhet8yMU7vlGZm4KTIqxgbxh0w89F8Kmp+dyfPi1p8DKOODtRknN+0xbIGN9a S5+neCXBhdeMrFwzLOi1CEpoBw+NvmVvaK+CGRZ4Ph44cEc5vpUzPzqUr/nYxO535kk2vhi 9JKYo3/RKpnFjGvlRdRToBuzerDMNN8aKt1W4tsdoS6ObreoeJiQV+fgLEQgFTdx48qD32i kCCC1GiObLRskeKo/UXBiM+/LNoFDnOnlR6tvpe3QbpzGKathTWuIsvv6fjRkTWGCn8+gR2 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+/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,vint8mf8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,vint8mf4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,vint8mf2_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,vint8m1_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,vint8m2_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,vint8m4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,vint8m8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t 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__riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vint32m4_t op1,vint32m4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vint32m8_t op1,vint32m8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vint64m1_t op1,vint64m1_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vint64m2_t op1,vint64m2_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vint64m4_t op1,vint64m4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vint64m8_t op1,vint64m8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vuint8mf8_t op1,vuint8mf8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vuint8mf4_t op1,vuint8mf4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t 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+vbool32_t test___riscv_vmadc(vuint64m2_t op1,vuint64m2_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vuint64m4_t op1,vuint64m4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vuint64m8_t op1,vuint64m8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + + +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times 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*/ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vmadc\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times 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{ dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,vint8mf8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,vint8mf4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,vint8mf2_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,vint8m1_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,vint8m2_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,vint8m4_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,vint8m8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,32); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t op1,vint16mf4_t op2,size_t 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b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vvm-1.C new file mode 100644 index 00000000000..4fae89cc404 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vvm-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,vint8mf8_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,vint8mf4_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,vint8mf2_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,vint8m1_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,vint8m2_t op2,vbool4_t carryin,size_t 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b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vvm-3.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,vint8mf8_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,vint8mf4_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,vint8mf2_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,vint8m1_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,vint8m2_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,vint8m4_t op2,vbool2_t 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test___riscv_vmadc(vint8mf2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint16mf2_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint16m1_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint16m2_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vint16m4_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool2_t test___riscv_vmadc(vint16m8_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vint32mf2_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint32m1_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint32m2_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint32m4_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vint32m8_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vint64m1_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint64m2_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint64m4_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint64m8_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vuint8mf8_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vuint8mf4_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vuint8mf2_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vuint8m1_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vuint8m2_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool2_t test___riscv_vmadc(vuint8m4_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool1_t test___riscv_vmadc(vuint8m8_t op1,uint8_t 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00000000000..09759341f61 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vx_rv32-2.C @@ -0,0 +1,289 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv32gcv -mabi=ilp32d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vint16mf2_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vint16m1_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vint16m2_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vint16m4_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool2_t test___riscv_vmadc(vint16m8_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vint32mf2_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vint32m1_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t 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op1,uint16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vuint16m4_t op1,uint16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool2_t test___riscv_vmadc(vuint16m8_t op1,uint16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vuint32mf2_t op1,uint32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vuint32m1_t op1,uint32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vuint32m2_t op1,uint32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vuint32m4_t op1,uint32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vuint32m8_t op1,uint32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool64_t test___riscv_vmadc(vuint64m1_t op1,uint64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + 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*/ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vmadc\.vx\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vmadc\.vx\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vmadc\.vx\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vmadc\.vx\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vmadc\.vx\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vmadc\.vx\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times 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00000000000..111edbbd24b --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vx_rv64-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint16mf2_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint16m1_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint16m2_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vint16m4_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool2_t test___riscv_vmadc(vint16m8_t op1,int16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vint32mf2_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint32m1_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint32m2_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint32m4_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vint32m8_t op1,int32_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vint64m1_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vint64m2_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vint64m4_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vint64m8_t op1,int64_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vuint8mf8_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vuint8mf4_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vuint8mf2_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vuint8m1_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool4_t test___riscv_vmadc(vuint8m2_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool2_t test___riscv_vmadc(vuint8m4_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool1_t test___riscv_vmadc(vuint8m8_t op1,uint8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool64_t test___riscv_vmadc(vuint16mf4_t op1,uint16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool32_t test___riscv_vmadc(vuint16mf2_t op1,uint16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool16_t test___riscv_vmadc(vuint16m1_t op1,uint16_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,vl); +} + + +vbool8_t test___riscv_vmadc(vuint16m2_t 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b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vx_rv64-2.C new file mode 100644 index 00000000000..6bbd96b4f9e --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vx_rv64-2.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,size_t vl) +{ + return __riscv_vmadc(op1,op2,31); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,size_t vl) +{ + return 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carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool8_t test___riscv_vmadc(vint16m2_t op1,int16_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool4_t test___riscv_vmadc(vint16m4_t op1,int16_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool2_t test___riscv_vmadc(vint16m8_t op1,int16_t op2,vbool2_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool64_t test___riscv_vmadc(vint32mf2_t op1,int32_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool32_t test___riscv_vmadc(vint32m1_t op1,int32_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool16_t test___riscv_vmadc(vint32m2_t op1,int32_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,31); +} + + +vbool8_t test___riscv_vmadc(vint32m4_t op1,int32_t op2,vbool8_t carryin,size_t vl) +{ + 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{vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vmadc\.vxm\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vmadc\.vxm\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vmadc\.vxm\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vmadc\.vxm\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vmadc\.vxm\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vmadc\.vxm\s+v[0-9]+,\s*v[0-9]+,\s*[a-x0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vmadc\.vvm\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 8 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv32-3.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv32-3.C new file mode 100644 index 00000000000..398f9afc7fb --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv32-3.C @@ -0,0 +1,289 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv32gcv -mabi=ilp32d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,int8_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,int8_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,int8_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,vbool2_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,int8_t op2,vbool1_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t op1,int16_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool32_t test___riscv_vmadc(vint16mf2_t op1,int16_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool16_t test___riscv_vmadc(vint16m1_t op1,int16_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool8_t test___riscv_vmadc(vint16m2_t op1,int16_t op2,vbool8_t carryin,size_t vl) +{ + return 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a/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv64-1.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv64-1.C new file mode 100644 index 00000000000..d5a93ee6a76 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv64-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,int8_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,int8_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,int8_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,vbool2_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool1_t test___riscv_vmadc(vint8m8_t op1,int8_t op2,vbool1_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool64_t test___riscv_vmadc(vint16mf4_t op1,int16_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool32_t test___riscv_vmadc(vint16mf2_t op1,int16_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool16_t test___riscv_vmadc(vint16m1_t op1,int16_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool8_t test___riscv_vmadc(vint16m2_t op1,int16_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool4_t test___riscv_vmadc(vint16m4_t op1,int16_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool2_t test___riscv_vmadc(vint16m8_t op1,int16_t op2,vbool2_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool64_t test___riscv_vmadc(vint32mf2_t op1,int32_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool32_t test___riscv_vmadc(vint32m1_t op1,int32_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool16_t test___riscv_vmadc(vint32m2_t op1,int32_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool8_t test___riscv_vmadc(vint32m4_t op1,int32_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool4_t test___riscv_vmadc(vint32m8_t op1,int32_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool64_t test___riscv_vmadc(vint64m1_t op1,int64_t op2,vbool64_t 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+ return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool4_t test___riscv_vmadc(vuint8m2_t op1,uint8_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool2_t test___riscv_vmadc(vuint8m4_t op1,uint8_t op2,vbool2_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool1_t test___riscv_vmadc(vuint8m8_t op1,uint8_t op2,vbool1_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool64_t test___riscv_vmadc(vuint16mf4_t op1,uint16_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool32_t test___riscv_vmadc(vuint16mf2_t op1,uint16_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool16_t test___riscv_vmadc(vuint16m1_t op1,uint16_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,vl); +} + + +vbool8_t test___riscv_vmadc(vuint16m2_t op1,uint16_t op2,vbool8_t carryin,size_t vl) +{ + return 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b/gcc/testsuite/g++.target/riscv/rvv/base/vmadc_vxm_rv64-3.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vbool64_t test___riscv_vmadc(vint8mf8_t op1,int8_t op2,vbool64_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool32_t test___riscv_vmadc(vint8mf4_t op1,int8_t op2,vbool32_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool16_t test___riscv_vmadc(vint8mf2_t op1,int8_t op2,vbool16_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool8_t test___riscv_vmadc(vint8m1_t op1,int8_t op2,vbool8_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool4_t test___riscv_vmadc(vint8m2_t op1,int8_t op2,vbool4_t carryin,size_t vl) +{ + return __riscv_vmadc(op1,op2,carryin,32); +} + + +vbool2_t test___riscv_vmadc(vint8m4_t op1,int8_t op2,vbool2_t carryin,size_t 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